A3R12E30DBF-8E

Zentel Japan
155-A3R12E30DBF-8E
A3R12E30DBF-8E

Fabricante:

Descripción:
DRAM DDR2 512Mb, 64Mx8, 800 at CL5, 1.8V, FBGA-60

Hoja de datos:
Modelo ECAD:
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En existencias: 63

Existencias:
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Plazo de entrega de fábrica:
16 Semanas Tiempo estimado de producción de fábrica para cantidades superiores a las que se muestran.
Mínimo: 1   Múltiples: 1
Precio unitario:
₡-,--
Precio ext.:
₡-,--
Est. Tarifa:

Precio (CRC)

Cantidad Precio unitario
Precio ext.
₡1 908,20 ₡1 908,20
₡1 786,40 ₡17 864,00
₡1 734,20 ₡43 355,00
₡1 693,60 ₡84 680,00
₡1 653,00 ₡165 300,00
₡1 600,80 ₡400 200,00
₡1 577,60 ₡788 800,00
₡1 542,80 ₡1 542 800,00
₡1 479,00 ₡3 579 180,00

Atributo del producto Valor de atributo Seleccionar atributo
Zentel Japan
Categoría de producto: DRAM
RoHS:  
SDRAM - DDR2
512 Mbit
8 bit
400 MHz
FPGA-60
64 M x 8
400 ps
1.7 V
1.9 V
0 C
+ 85 C
DDR2
Tray
Marca: Zentel Japan
País de ensamblaje: Not Available
País de difusión: Not Available
País de origen: TW
Sensibles a la humedad: Yes
Estilo de montaje: SMD/SMT
Tipo de producto: DRAM
Cantidad de empaque de fábrica: 2420
Subcategoría: Memory & Data Storage
Corriente de suministro - Máx.: 65 mA
Nombre comercial: Zentel Japan
Peso de la unidad: 159 mg
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Atributos seleccionados: 0

Hoja de datos

CNHTS:
8542329000
USHTS:
8542320028
ECCN:
EAR99

DDR2 SDRAM

Zentel DDR2 SDRAM features a double-data-rate architecture with two data transfers per clock cycle. The high-speed data transfer is realized by the 4 bits prefetch pipelined architecture. A bi-directional differential data strobe (DQS and /DQS) is transmitted/received with data for capturing data at the receiver. DQS is edge-aligned with data for READs; center-aligned with data for WRITEs Differential clock inputs (CK and /CK). The DLL aligns DQ and DQS transitions with CK transitions.

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