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AS4C128M16MD4-062BAN

Name: Alliance Memory AS4C128M16MD4-062BAN
Brand: Alliance Memory
SKU: 913-C128M16MD4062BAN
Price: 31065 CRC
Availability: InStock

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Mouser N.º:

913-C128M16MD4062BAN

Fabricante N.º:

AS4C128M16MD4-062BAN

Fabricante:

Alliance Memory

Descripción:

DRAM LPDDR4, 2G, 128M x 16, 1.1V, 200 BALL TFBGA, 1600MHZ, ECC, AUTO TEMP - Tray

Hoja de datos:

AS4C128M16MD4-062BAN Hoja de datos (PDF)

Modelo ECAD:

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Precio (CRC)

Cantidad	Precio unitario	Precio ext.
	₡31 065	₡31 065
	₡28 716	₡287 160
	₡27 788	₡694 700
	₡27 098	₡1 354 900
	₡26 413	₡2 641 300
	₡25 532	₡6 944 704

.hidden-for-nojs { display: none; } .pull-right-nojs { justify-content: flex-end; }

Atributo del producto	Valor de atributo	Seleccionar atributo
Fabricante:	Alliance Memory
Categoría de producto:	DRAM
RoHS:
Tipo:	SDRAM Mobile - LPDDR4
Tamaño de memoria:	2 Gbit
Ancho de bus de datos:	16 bit
Frecuencia de reloj máxima:	1.6 GHz
Paquete / Cubierta:	FBGA-200
Organización:	128 M x 16
Tiempo de acceso:	3.5 ns
Voltaje de alimentación - Mín.:	1.06 V
Voltaje de alimentación - Máx.:	1.95 V
Temperatura de trabajo mínima:	- 40 C
Temperatura de trabajo máxima:	+ 105 C
Empaquetado:	Tray
Marca:	Alliance Memory
País de ensamblaje:	Not Available
País de difusión:	Not Available
País de origen:	CN
Sensibles a la humedad:	Yes
Estilo de montaje:	SMD/SMT
Tipo de producto:	DRAM
Cantidad de empaque de fábrica:	136
Subcategoría:	Memory & Data Storage
Corriente de suministro - Máx.:	39.5 mA

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Hoja de datos

AS4C128M16MD4-062BAN Hoja de datos (PDF)

REACH Declaration (PDF)

USHTS:: 8542320036
ECCN:: EAR99

2GB/4GB/8GB/16GB/32GB LPDDR4 SDRAM

Alliance Memory 2GB/4GB/8GB/16GB/32GB LPDDR4 SDRAM is organized as 1 or 2 channels per device, and the individual channel is 8-banks and 16-bits. This product uses a double-data-rate architecture to achieve high-speed operation. The double data rate architecture is a 16n prefetch architecture with an interface. It's designed to transfer two data words per clock cycle at the I/O pins. These devices offer fully synchronous operations referenced to the rising and falling edges of the clock. The data paths are internally pipelined and 16n bits prefetched to achieve very high bandwidth.